인텔의 Stacy Smith 부사장은 무어의 법칙이 아직 죽지 않았다고 강조했습니다.
14nm 공정 이후 10nm, 그리고 7nm, 뒤이어 5nm 공정까지도 염두에 두고 있다네요.
14nm 공정이 3년 동안 쓰였으니 10nm 공정도 최소 3년은 쓸 거라고 합니다. 10nm+, 10nm++ 같은 식으로 발전해 나갈 듯.
인텔은 10nm의 트랜지스터 밀도가 14nm의 2.7배고 제조 원가는 30% 줄어든다고 설명합니다.
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소식
2017.03.29 22:24
인텔, 10nm는 최소 3년, 5nm도 염두에 둠
GTX 1060/1080 Ti, 포 아너/고스트 리콘 게임 번들
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14나노 3세대 → 10나노 1세대가 아닌
14나노 1세대 → 10나노 1세대 기준일수도 있어요 -
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14nm끼리는 동작 특성이 개선되는 거지 밀도가 바뀌진 않아요.
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x nm가 채널길이를 일반적으로 나타내는 거라 한 트랜지스터의 밀도를 정확히 반비례하는게 아닙니다.
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역시 인텔답게 밀도가 압도적이군요.
타사 7nm까지 10nm+으로 뻐겨도 될듯... -
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euv 적용 배선층수를 공정성숙도 따라서 한층 한층 늘려가겠죠. 그래도 5nm급부터는 더블패터닝을 사용해야 할텐데.
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밀도의 상태가...?
진짜 타사 7nm에 비벼도 되겠네요 -
10nm 나오는데 3년걸린다고 오해했네요... -
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공정 밀도가 높아보아야 설계가...
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근데 밀도 자체는 인텔이 이번에 꽤 많이 높인 것도 있지만 애초에 타사들이 노드 네이밍을 뻥튀기로 하는 거 자체가 문제죠...
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앞으로는 이런 노드 뻥튀기가 더 심해질거 같아요. 특히 TSMC의 12나노나 삼성의 8/6나노가 뻥튀기 공정이 아닐까 하는 생각이 드네요
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저래봤자 시기 자체가 늦어지면 말짱 꽝이죠...
아무리 봐도 카비레이크 리프레시 내고 있을때 타사는 진작 10나노 공정 돌릴 예정이고 캐논레이크 낼때 타사는 멀티패터닝/EUV 7나노 돌릴텐데요.
PPA중 A에서 인텔이 앞서간다고 해도 PP에서 부족하면 꽤나 힘들겁니다. -
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맨날 공정 앞선다고 하는데 나오는거 보면 딱히 말한만큼 앞서지도 않는것 같단 말이죠 인텔은...
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무어가 돌아가신지가 언젠데... 5년 전에 산 cpu가 아직도 현역 클래스고 비벼볼만하구만.. 뭔 헛소린지
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혹시 고든무어가 언제 죽었는지 출처좀 알려주실 수 있으실까요? 그리고 무어의 법칙은 2년마다 집적도가 2배씩 향상된다는 걸 나타냅니다..
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인텔, 10nm는 최소 3년, 5nm도 염두에 둠
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