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참고/링크 https://github.com/westerndigitalcorporation/swerv_eh1

western-digita-risc-v-678_678x452.jpg

 

웨스턴 디지털이 RISC-V 아키텍처의 SweRV 코어 디자인을 오픈 소스로 공개했습니다. 깃허브에서 관련 자료를 볼 수 있습니다. RISC-V의 보급을 위해서 이렇게 하겠지요? 웨스턴 디지털의 브랜드만 안 쓴다면 코어 수정이나 사용에는 별 제한이 없는 듯 합니다. 

 

SweRV 코어는 2웨이 슈퍼 스칼라와 9 스테이지 파이프라인으로 구성된 32비트 인 오더 코어입니다. 28nm 공정 제조, 최고 1.8GHz로 실행. 성능은 4.9 CoreMark/MHz로 ARM Cortex-A15보다 약간 높습니다. 

 

western-digita-risc-v-core_575px.png

 

western-digita-risc-v-perf_575px.png

 



  • profile
    쮸쀼쮸쀼 2019.02.16 20:45
    인 오더인데 아웃 오브 오더인 ARM Cortex-A15보다 성능이 높다니?!
  • profile
    ExyKnox      2019년 19살 엑시녹스입니다 으엉엉 2019.02.16 21:48
    특정 상황에 맞추기 좋은 리스크파이브라서 서로 비교하긴 좀 그런 구석이 있긴 한데, 그게 장점이겠죠.
  • profile
    白夜2ndT      원래 암드빠의 길은 외롭고 힘든거에요! 0ㅅ0)-3 / Twitter @2ndTurning 2019.02.19 09:20
    대기업에서 이런 식으로 푸쉬한다면 ARM의 일부영역을 RISC-V가 차지하는 것도 농담이 아니겠네요.

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