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참고/링크 https://gigglehd.com/gg/hard/7780094

여기서 말하는 듀얼 채널이란 건 모듈 하나에 64bit 단일 채널에서 32bit 2채널로 분리가 가능하다는 것이고, 이건 이미 기존 GDDR에서 가능하던 클램쉘(Clemshell) 모드랑 비슷한 개념 아니었나요?

GDDR도 기본은 채널 당 32bit 버스지만, 클램쉘 모드를 적용시 16bit 2채널로 분리할 수 있으니까요.



  • ?
    quapronuet 2021.01.11 14:33
    lpddr이나 gddr6 표준 스펙처럼 기존 채널 폭 반으로 2개로 나누고 독립적으로 동작하는 구조라 말 그대로 듀얼 채널이긴 한데 어차피 대역폭이 목표면 당연히 기존처럼 dimm 2개 이상 써야겠죠.
  • profile
    류오동      컴알못입니다. 2021.01.11 14:45
    이게 실질적으로 나아질 만한 요소는 뭐가 있을까요?

    GDDR 같은 경우 메모리 칩을 2배로 더 때려박아 용량이라도 더 늘렸는데 DDR5 같은 경우는 쿼드랭크/옥타랭크 구성도 가능해지게 되는 것일까요?
  • profile
    title: 하와와360ghz      파이토치로 이주하였습니다 ::: 5800X+RTX3080 2021.01.11 15:33
    기존 부품이랑 동일하게 1대1 비교가 가능한 상황이면 모르겠으나, 메모리칩에 조정기능도 올라가고 있어서 나와봐야 왜 저런 변화가 일어났는지 알 수 있을거 같은데요...
  • ?
    quapronuet 2021.01.11 15:53
    채널 쪼개서 듀얼 채널로 만들어서 얻는 이익은 생각보다 다양하게 있다고 합니다만 (물리적으로 하나의 칩에 두 채널 각각에 대해 구현하는 구조에서 오는 거리적인 효율, 용량 확장 용이성 등)
    대역폭 증가 (I/O 클럭속도 증가)라는 목적에서 보면 근본적으로 dram core(array) 레이턴시를 줄이는데는 한계가 있으니 결국 최대한 내부적으로 병렬적인 구조 (더 많은 뱅크)를 만들거나 burst length (한 뱅크에서 읽어오는 크기)를 늘려야 하죠.
    근데 단순히 burst length를 늘려버리면 burst당 접근 크기 (채널당 64-bit에 burst length가 16이라면 128B)가 일반적인 cache line 크기 (64B)랑 안 맞아서 효율적으로 별로 좋을 게 없으니 그냥 채널폭 자체를 반으로 쪼개버리면 된다는 얘기인거죠. 뭐 ddr4에서는 이 짓을 안하려고 bank group 개념을 도입하고 bank 수 늘려서 burst length 안 늘리고도 대역폭을 올리긴 했습니다만.

    물론 이 외에도 채널당 별도 클럭과 row activation 분리로 전력 관리에 이익이 있을 거 같긴 합니다만 애초에 저도 그다지 자세하게 아는게 아니라 더 얘기하는게 별 의미는 없을거 같네요.
  • profile
    동방의빛 2021.01.11 14:46
    실제 구조가 어떻건 최종 대역폭만 보면 되는데요. DDR4 최대 속도가 3200인데, DDR5가 6400이라는 걸 보면 하나만으로 이루어지는 구조는 아닐거라고 봅니다. 만약 불가능하면 DDR5 세대에서 DDR4 듀얼채널을 못 이긴다는 말이 되니까요. 문제는 쿼드채널이 된다는 건데, 그래서 ECC가 등장한 걸테고요.
  • ?
    고자되기 2021.01.11 15:47
    혹시 저가형 머바일이나 저가형 노트북에서 칩배치를 유연하게 하라고 넣은건 아닐까요.나중에 cpu가 ddr5만 지원하는 놈일때 ddr4시절 대역이랑 용량이면 충분한데..싶으면 32비트로 넣을수 있다던지.
    엔트리급 그래픽카드에서는 종종 나오던거라.
    (G210이나 205를 32비트 d3로도 64비트 d2로도 만들었죠)
  • profile
    title: 귀요미소망노인복지센터 2021.01.11 20:41
    메모리는 계속해서 듀얼 채널로 구성해야 맛이군요.


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