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참고/링크 https://videocardz.com/newz/amd-navy-flo...memory-bus

AMD RDNA 2 아키텍처는 10월 28일에 발표됩니다. 최소한 그 때 라데온 RX 6000 시리즈 그래픽카드 2개가 공개될 겁니다. 

 

AMD는 나비 21, 22, 23을 개발하고 있는데 21은 Sienna child, 22와 23은 Navy Flounder라는 코드네임을 사용합니다. 21이 최상위 모델이고 23이 보급형입니다. 

 

Navy Flounder는 ROCm update (3.8)에 펌웨어가 등록됐습니다. 40개의 CU로 나비 10과 같고, 메모리 인터페이스는 192비트입니다. 192비트라고 써진 건 아닌데 gc_num_tccs로 추정되는 값이 192비트입니다. 컴퓨트 유닛의 구성이 같다면 스트림 프로세서의 수는 2560개가 됩니다. 

 

2009_SS_TS22601s.jpg

 


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    quapronuet 2020.09.23 01:28
    tcc가 texture channel cache라는데 뭔지 정확히는 모르겠지만 정황상 L2 캐시인거 같네요.
    본문에서는 딱히 gc_num_tccs 값을 버스 너비에 연결짓는 내용은 안보이네요. 원래 있다가 삭제된건가요?

    shader engine 구성은 render backend 개수가 반으로 줄어든거 말고는 기존 navi랑 동일한거 같은데, 아무튼 shader engine 수가 2배 차이인데 L2 캐시 수가 저것밖에 차이 안나는건 그냥 기존 rdna랑 마찬가지로 L2 4 슬라이스와 64 bit 메모리 컨트롤러 하나를 묶어놓은 구성이라서려나요. 이 경우에는 버스 구성이 192bit/256bit라는 얘기가 되긴 할텐데 말이죠.

    만약 이 경우라면 Sienna Cichlid의 경우 L2 슬라이스당 용량이 훨씬 크다던가 해서 L2가 엄청 크다던 예전의 루머처럼 될 수도 있을까 싶기는 한데, 과연 어떻게 나올 지 모르겠네요.
    어떤 루머는 채굴 성능을 너프하기 위해서 캐시를 늘리고 메모리 대역폭을 제한한거라는 믿거나 말거나 수준의 얘기도 있던데 말이죠.
  • ?
    its      시도 때도 없이 잠수.... https://crazyits.tistory.com/ 2020.09.23 01:37
    저것 원래 출처가.. reddit


    https://www.reddit.com/r/Amd/comments/ixktae/navy_flounder_has_40_cus_and_192bit_bus_source/

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